随著资料中心向更高的带宽和更高速的基础架构迁移，对更高效能时脉元件的需求变的至关重要。Microchip Technology Inc.近日宣布推出针对下一代资料中心应用的四款全新20路差动时脉缓冲器，远超PCIe®第五代(Gen 5)防抖标准。新推出的 (终端电阻85Ω) 和(终端电阻100Ω)专门依据最新的DB2000Q规格设计，而 (终端电阻85Ω) 和 (终端电阻100Ω)则依照DB2000QL工业标准设计。所有新产品均可适用于下一代服务器、资料中心、内存元件及其他PCIe应用，且同时满足PCIe第一代、第二代、第三代和第四代的规格。

 

各款缓冲器均可作为分散式时脉搭配多种周边元件的芯片组，例如资料中心服务器和内存元件的中央处理器（CPU）、现场可程序设计闸阵列（FPGA）及实体层（PHY），同时还适用于大量其他PCIe应用。大约20飞秒(~20 fs)的低附加抖动缓冲器，远超DB2000Q/QL规格的80飞秒(80 fs)，为设计师留出巨大空间，能够在增加资料处理速率的同时，满足紧凑的时脉预算要求。当时脉分配到多达20路输出时，上述元件均可实现超低抖动，确保缓冲器时脉信号的完整性和品质。

 

新型时脉缓冲器透过低功耗高速电流转向逻辑（LP-HCSL）实现低功耗，将大幅减少功耗方面的预算。与标准高速电流转向逻辑（HCSL）相比，LP-HCSL可节省三分之一功耗，大幅减少用电量。这一效能可协助客户在电路板上实现更长的走线，改善信号通路，同时减少元件，节省电路板空间。以ZL40292为例，相比传统HCSL缓冲器，它最多可省去80个终端电阻器（平均每路4个）。

 

Microchip时脉与通讯业务事业部副总裁Rami Kanama表示：“Microchip可提供业内最丰富的时脉和时脉产品，并一直致力于开发面向更高速的资料中心和企业基础架构等下一代网络应用的高标准解决方案。Microchip此前推出效能卓越的PCIe第五代元件，可为工程师留出更大的设计空间，让他们能够更加专注设计，可帮助寻找符合DB2000Q和DB2000QL规格时脉缓冲器的客户快速开始设计流程。”

 

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